AMD 第2世代EPYC「Rome」発表

(Source:techPowerUp!)

AMDは、8月7日に開催されたイベントで、第2世代EPYC「Rome」を発表しました。最大64コアの「Zen 2」を搭載し、CPU chipletは7nmプロセスで製造されます。イベントではデータセンターパートナーや顧客に「Rome」の持つ性能・先進性が示され、新アーキテクチャと最先端の製造プロセスによる実現された記録的な性能と、Total Cost of Ownership (TCO) の25~50%の削減が、様々なワークロードにおいて可能であることが示された。GoogleとTwitterは第2世代EPYCの採用を発表しており、HPEおよびLenovoも今回のイベントともに新プラットフォームを発表してます。第1世代と同様に末尾「P」のモデルは1-way専用モデルで、それ以外は2-wayまで対応する。また全てのモデルがI/OとしてPCI-Express 4.0を128レーン備えます。「Naples」EPYC 7001で使用していた既存のSocketSP3マザーにおいてもBIOS updateにより「Rome」に対応できるもののPCI-Express 4.0の機能を生かす場合は「Rome」に向けたマザーボードが必要になります。メモリは全モデル8ch DDR4-3200対応、Socketあたり最大4TBを搭載できます。既報の通り、「Rome」(EPYC 7002)は「Naples」(EPYC 7001)と構成が劇的に変更されています。「Naples」は4コア×2 CCXの8コアのCPUと2chメモリコントローラ・32レーンのPCI-Express 3.0等のI/Oを備えたダイを4つ搭載することにより32コアを実現しています。「Rome」は7nmのCPU dieと14nmのI/O dieに分離され、CPU dieには「Zen 2」世代の4コア×2 CCXの8コアのCPUコアが、そしてI/O dieには128レーンのPCI-Express 4.0や8chのメモリコントローラ等のI/Oが全て集約されます。CPU dieとI/O dieはinfinity fabricで接続されます。もちろんCPUコアは「Zen 2」に進化しているので、Zen→Zen 2で行われた改良も備わっていて、コア数の向上だけでなく、IPCの向上も図られています。2-way構成時は「Rome」が有する128の高速I/Oのうち、64レーン分を用いて2つのCPUを構成するのは前世代同様です。故に、2-way構成時のPCI-Express 4.0レーン数も基本的には128レーンとなるようです。

ModelCoresThreadsBase Freq (GHz)Max Boost Freq (GHz)Default TDP L3 Cache (MB)
7742641282.253.4225w256
77026412823.35200w256
7702P6412823.35200w256
764248962.33.3225w256
755248962.23.3200w192
754232642.93.4225w128
750232642.53.35180w128
7502P32642.53.35180w128
745232642.353.35155w128
740224482.83.35180w128
7402P24482.83.35180w128
735224482.33.2155w128
7302163233.3155w128
7302P163233.3155w128
728216322.83.2120w64
727212242.93.2120w64
72628163.23.4155w128
72528163.13.2120w64
7232P8163.13.2120w32
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